一个数字电路基础题:集电极开路门74LS03驱动5个CMOS逻辑门,计算上拉电阻的值(正确加20分)

kuaidi.ping-jia.net  作者:佚名   更新日期:2024-09-11
一个数字电路基础题:集电极开路门74LS03驱动5个CMOS逻辑门,计算上拉电阻的值(正确加20分

74LS03输出低电平时:最大电压0.5V,最大吸收8MA电流,上拉电阻最小值=(5-0.5)/8=0.56k,这个数值是要记住的。 74LS03输出高电平时:最大漏电流0.1mA,设计上拉电阻压降小于0.5V,电阻就是5K

除三态门、集电极开路门外,TTL集成电路的 输出端不允许并联使用,如果将几个集电极开路门电路的输出端并联,实现“线与”功能时,应在输出端 与电源之间接人上拉电阻。
多余的输出端应该悬空处理,决不允许直接接到VDD或VSS,否则会产生过大的短路电流而使器件 损坏 。不同逻辑功能的CM0S电路的输出端也不能直接连到一起,否则导通的P沟道MOS场效应管和导通的N沟道 MOS场效应管形成低阻通路,造成电源短路而引起器件损坏。

扩展资料
TTL电平信号:
1、TTL电平信号被利用的最多是因为通常数据表示采用二进制规定,+5V等价于逻辑“1”,0V等价于逻辑“0”,这被称做TTL(晶体管-晶体管逻辑电平)信号系统,这是计算机处理器控制的设备内部各部分之间通信的标准技术。
2、、计算机处理器控制的设备内部的数据传输对于电源的要求不高以及热损耗也较低,另外TTL电平信号直接与集成电路连接而不需要价格昂贵的线路驱动器以及接收器电路。
3计算机处理器控制的设备内部的数据传输是在高速下进行的,而TTL接口的操作恰能满足这个要求。
参考资料来源:百度百科-数字集成电路

74LS03输出低电平时:最大电压0.5V,最大吸收8MA电流,上拉电阻最小值=(5-0.5)/8=0.56k,这个数值是要记住的。
74LS03输出高电平时:最大漏电流0.1mA,设计上拉电阻压降小于0.5V,电阻就是5K。要精确计算再加上5个CMOS门的电流。不知道你的老师提出的设计依据是什么。
电阻在0.56K----5K之间,就可以保证逻辑正确。
这样的问题我在设计中是不计算的,对功耗要求不高,或者是用在干扰大的部位,电阻取小些就是了,一般取2、3K。

最低要求时,第二项可以这样算:
CMOS输入最小高电平是电源电压的70%=0.7*5=3.5v,3.5/(0.2+0.005)=17.07K。

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